]> rtime.felk.cvut.cz Git - zynq/linux.git/blob - drivers/gpu/drm/xlnx/Kconfig
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[zynq/linux.git] / drivers / gpu / drm / xlnx / Kconfig
1 config DRM_XLNX
2         tristate "Xilinx DRM KMS Driver"
3         depends on DRM && OF
4         select DRM_KMS_HELPER
5         select DRM_KMS_CMA_HELPER
6         select DRM_GEM_CMA_HELPER
7         help
8           Xilinx DRM KMS driver. Choose this option if you have
9           a Xilinx SoCs with hardened display pipeline or soft
10           display pipeline using Xilinx IPs in FPGA. This module
11           provides the kernel mode setting functionalities
12           for Xilinx display drivers.
13
14 config DRM_XLNX_BRIDGE
15         tristate "Xilinx DRM KMS bridge"
16         depends on DRM_XLNX
17         help
18           Xilinx DRM KMS bridge. This module provides some interfaces
19           to enable inter-module communication. Choose this option
20           from the provider driver when the Xilinx bridge interface is
21           needed.
22
23 config DRM_XLNX_BRIDGE_DEBUG_FS
24         bool "Xilinx DRM KMS bridge debugfs"
25         depends on DEBUG_FS && DRM_XLNX_BRIDGE
26         help
27           Enable the debugfs code for Xilinx bridge. The debugfs code
28           enables debugging or testing related features. It exposes some
29           low level controls to the user space to help testing automation,
30           as well as can enable additional diagnostic or statistical
31           information.
32
33 config DRM_ZYNQMP_DPSUB
34         tristate "ZynqMP DP Subsystem Driver"
35         depends on ARCH_ZYNQMP && OF && DRM_XLNX && COMMON_CLK
36         select XILINX_DPDMA
37         select PHY_XILINX_ZYNQMP
38         help
39           DRM KMS driver for ZynqMP DP Subsystem controller. Choose
40           this option if you have a Xilinx ZynqMP SoC with DisplayPort
41           subsystem. The driver provides the kernel mode setting
42           functionlaities for ZynqMP DP subsystem.
43
44 config DRM_XLNX_DSI
45         tristate "Xilinx DRM DSI Subsystem Driver"
46         depends on DRM_XLNX
47         select DRM_MIPI_DSI
48         select DRM_PANEL
49         select BACKLIGHT_LCD_SUPPORT
50         select BACKLIGHT_CLASS_DEVICE
51         select DRM_PANEL_SIMPLE
52         help
53           DRM driver for Xilinx MIPI-DSI.
54
55 config DRM_XLNX_MIXER
56         tristate "Xilinx DRM Mixer Driver"
57         depends on DRM_XLNX
58         help
59           DRM driver for Xilinx Mixer driver
60
61 config DRM_XLNX_PL_DISP
62         tristate "Xilinx DRM PL display driver"
63         depends on DRM_XLNX
64         help
65           DRM driver for Xilinx PL display driver, provides drm
66           crtc and plane object to display pipeline. You need to
67           choose this option if your display pipeline needs one
68           crtc and plane object with single DMA connected.
69
70 config DRM_XLNX_SDI
71         tristate "Xilinx DRM SDI Subsystem Driver"
72         depends on DRM_XLNX
73         help
74           DRM driver for Xilinx SDI Tx Subsystem.
75
76 config DRM_XLNX_BRIDGE_CSC
77         tristate "Xilinx DRM CSC Driver"
78         depends on DRM_XLNX_BRIDGE
79         help
80           DRM brige driver for color space converter of VPSS. Choose
81           this option if color space converter is connected to an encoder.
82           The driver provides set/get resolution and color format
83           functionality through bridge layer.
84
85 config DRM_XLNX_BRIDGE_SCALER
86         tristate "Xilinx DRM Scaler Driver"
87         depends on DRM_XLNX_BRIDGE
88         help
89           DRM brige driver for scaler of VPSS. Choose this option
90           if scaler is connected to an encoder. The driver provides
91           upscaling, down scaling and no scaling functionality through
92           bridge layer.
93
94 config DRM_XLNX_BRIDGE_VTC
95         tristate "Xilinx DRM VTC Driver"
96         depends on DRM_XLNX_BRIDGE
97         help
98           DRM brige driver for Xilinx Video Timing Controller. Choose
99           this option to make VTC a part of the CRTC in display pipeline.
100           Currently the support is added to the Xilinx Video Mixer and
101           Xilinx PL display CRTC drivers. This driver provides ability
102           to generate timings through the bridge layer.